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MEM:SAMSUNG TCCC(PC3200/256MB)
CPU:SDA2800AIO3BX(Palermo,E6)
VGA:MS-8881²þ(300/550)
OS:WindowsXP SP3

SDA2800AIO3BX
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2D Mark 2011¡á1011
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582MB/s:DHD0900AMT1B(1193MHz)AMD761(133)
440MB/s:SL44J(929.3MHz)Åö³º¥Þ¥¶¡¼AP266(133)
378MB/s:A0800AMT3B(960.0MHz)MAGiK1(120)
360MB/s:SL44J(930.2MHz)i815E(133)
(Ãí¡§Åö³º¥Þ¥¶¡¼¤Ï¥Ç¥Õ¥©¥ë¥ÈÀßÄê¤À¤¬Â¾¤ÏºÇ®ÀßÄê)

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50h:Request Phase Control (00h)

7 CPU Hardwired IOQ (In Order Queue) Size
0 1-Level
1 4-Level

6 Read-Around-Write
0 Disable(default)
1 Enable

5 Reserved always reads 0

4 Defer Retry When HLOCK Active
0 Disable(default)
1 Enable

3-1 Reserved always reads 0

0 CPU / PCI Master Read DRAM Timing
0 Start DRAM read after snoop complete(default)
1 Start DRAM read before snoop complete

¡á51H-D8H[11011000]¡á
51h:Response Phase Control (00h)

7 CPU Read DRAM 0ws for B2B Read Transactions
0 Disable(default)
1 Enable

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6 CPU Write DRAM 0ws for B2B Write Transactions
0 Disable(default)
1 Enable

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5 Reserved always reads 0

4 Fast Response (HIT/HITM sample 1T earlier)
0 Disable(default)
1 Enable

3 Non-Posted IOW
0 Disable(default)
1 Enable

2-1 Reserved always reads 0

0 Concurrent PCI Master / Host Operation
0 Disable(default)
1 Enable -

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54:00[00000000]¢ª00[00000000]
55:00[00000000]¢ª00[00000000]
56:10[00010000]¢ª10[00010000]
57:10[00010000]¢ª10[00010000]
58:08[00001000]¢ª08[00001000]
59:00[00000000]¢ª00[00000000]
5A:00[00000000]¢ª00[00000000]
5B:00[00000000]¢ª00[00000000]
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5F:10[00010000]¢ª10[00010000]
60:0C[00001100]¢ª0C[00001100]
61:0A[00001010]¢ª0A[00001010]
62:00[00000000]¢ª00[00000000]
63:20[00100000]¢ª20[00100000]
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65:D4[11010100]¢ª12[00010010]*
66:D4[11010100]¢ª12[00010010]*
67:D4[11010100]¢ª12[00010010]*
68:21[00100001]¢ªE1[11100001]*
69:20[00100000]¢ª20[00100000]
6A:65[01100101]¢ª65[01100101]
6B:0F[00001111]¢ª2D[00101101]*
6C:40[01000000]¢ª48[01001000]*
6D:21[00100001]¢ª21[00100001]
6E:00[00000000]¢ª00[00000000]
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